[互助]ADS  PLL相位噪声仿真模型中计算问题

各位大神好，仿真遇到一棘手问题，希望各位大神百忙之中能够帮忙指导一下！ p=x&X~  
问题如下：图1的仿真模型中给定了F和L的定义，但不明白为什么L4和L3值相同？F4又为什么要设置为-1000？查了help无详细解释，相关仿真教程中也未做特别说明。还有图2和图3中的计算公式，看不太懂，那位大神清楚，能否说明一下？ Nr,I`x\N
 
在线等~~先谢谢大家啦！ GtIAsC03  
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图片:aa.jpg

图1  频综系统的相噪仿真模型 d`$w3Hy  
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图片:bb.jpg

图2  参考信号源Push  Into  Hierarchy后的内部模型和计算公式 w;AbJCv2  
f]?&R c2C  
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第一个问题描述错了，重新阐述：对于每一个器件，为什么最后一个L和倒数第二个L的值都要为10Hz，且最后一个L对应的F=-1000？

先声明: 我只负责破题、解题是出题者的责任。 qxu3y+po]  
Phase Noise 的表示法是:  -xx(十进位制) dBc/Hz，那个c 意思是相对。其实你要知道的亊情都在你的贴图中已经说完了! Bdb}4X rL  

图片:09.jpg

Jcm
Jq fR  
发现什么了?? 相对频率越小、-dB値就越大! 再看一次你自己的贴图... S)j(%
g  

图片:26_85565_be8f85738c2baa3.jpg

"#E<Leh'  
L=-1000 按你贴图中的说明调整一下，成为40dB/-1000 -> -40dBc/1000Hz -> 十进制一下=> -40dBc / KHZ (offset) bp=r]nO  
** 由此反推当offset = 100Hz时 -30dBc/100Hz 会比-40dBc / KHZ 大，也就不足为奇了。发现第一张图的重点了吗? Y<irNp9  
这就是我说的: 形不是重点、意才能区分高下。 M\{\WyeX  
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